TECHNICAL UPDATE グループユーザーズマニュアル正誤表（Rev. C）

(1)

お客様各位

カタログ等資料中の旧社名の扱いについて

2010 年 4 月 1 日を以って NEC エレクトロニクス株式会社及び株式会社ルネサステクノロジが合併し、両社の全ての事業が当社に承継されております。従いまして、本資料中には旧社名での表記が残っておりますが、当社の資料として有効ですので、ご理解の程宜しくお願い申し上げます。

ルネサスエレクトロニクスホームページ（http://www.renesas.com）

2010 年 4 月 1 日

ルネサスエレクトロニクス株式会社

【発行】ルネサスエレクトロニクス株式会社（http://www.renesas.com）

【問い合わせ先】http://japan.renesas.com/inquiry

(2)

発行日： 2004 年 01 月 16 日

RENESAS TECHNICAL UPDATE

〒 100-0004 東京都千代田区大手町 2-6-2 日本ビル株式会社ルネサステクノロジ

問合せ窓口 E-mail: [email protected] 製品分類

MPU&MCU

発行番号 TN-32R-059A/JA

Rev.

^第１版

題

名

³²¹⁷¹

グループユーザーズマニュアル正誤表（

Rev. C

）

情報分類

ドキュメント訂正追加等

対象ロット等適

用製品

32171

グループ

−−

グループ

ユーザーズマニュアル

2001

年

9

月に発行されました「

32171

グループユーザーズマニュアル

Rev. 2.0

」に、内容の訂正がありましたので

お知らせいたします。

32171

グループユーザーズマニュアル

Rev2.0

をご利用の際は、添付の正誤表をご使用ください。

なお、添付の正誤表（

Rev. C

）には、同マニュアルの正誤表（

Rev. A

）と正誤表（

Rev. B

）の内容も記載しています。

・［ニュース

No. M32R-39-0204

］：正誤表（

Rev. A

）

・［ニュース

No. M32R-43-0206

］：正誤表（

Rev. B

）

添付資料：

32171

グループユーザーズマニュアル正誤表（

Rev. C

）

...17

枚

(3)

RENESAS TECHNICAL UPDATE TN-32R-059A/JA 発行日： 2004 年 01 月 16 日

Page 2 of 18

ページ箇所内容

（誤）何も配置されていません

書き込み時の条件：書き込み無効

Rev. C

で追加

全章未配置ビットの処理

（正）何も配置されていません。”0”に固定してください。

書き込み時の条件：常に

0

を書き込む

(4)

RENESAS TECHNICAL UPDATE TN-32R-059A/JA 発行日：2004

年

01

月

16

日

5-6 注意書き

ページ箇所内容

（誤）

（正）

Rev. A で追加

EITハンドラ（PSWレジスタのIEビットが禁止状態）以外での、割り込みベクタレジスタ（IVECT）の読み出しは行わないでください。またEITハンドラでは、割り込みマスクレジスタ（IMASK）を読み出した後にIVECTレジスタを読み出してください。

注意

注意書きの内容（下線部分）を訂正。

EITハンドラ内でPSWレジスタのIEビットが禁止状態以外では、割り込みベクタレジスタ（IVECT）の読み出しは行わないでください。またEITハンドラでは、割り込みマスクレジスタ（IMASK）を読み出した後にIVECTレジスタを読み出してください。

注意

EITハンドラ（PSWレジスタのIEビットが禁止状態）以外での、割り込みマスクレジスタ（IMASK）への書き込みは行わないでください。

注意 5-7 注意書き

注意書きの内容（下線部分）を訂正。

（誤）

EITハンドラ内でPSWレジスタのIEビットが禁止状態以外では、割り込みマスクレジスタ（IMASK）への書き込みは行わないでください。

（正）注意 Rev. A

で追加

7-4 ヘッダー部〜7-7

ヘッダー部に記載の節題を訂正 7.3 リセット解除直の内部状態

（誤）

（正）

7.3 リセット解除後の内部状態

Rev. A

で追加

(5)

RENESAS TECHNICAL UPDATE TN-32R-059A/JA 発行日： 2004 年 01 月 16 日

Page 4 of 18

ページ箇所内容

Rev. C

で追加

5-10 ICU

IREQビッ

トの注釈追加

割り込み制御レジスタ IREQ（割り込み要求）ビットの注釈に以下を追記。

注. ・IREQ ビットをクリアしても、CPU コアへの割り込み要求(EI)は、クリアされません。CPU コアへの割り込み要求(EI)は、次の動作によってのみクリアされます。

（１）リセット

（２）IVECT レジスタの読み出し

（３）IMASK レジスタへの書き込み

Rev. C

で追加

5-11

図

5.3.2,

図

5.3.3

差し替

え

ฦౝ⬿๟ㄝI/O߆ࠄߩ

ഀࠅㄟߺⷐ᳞

ഀࠅㄟߺ⸵น

ILEVEL [0-7࡟ࡌ࡞]

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ഀࠅㄟߺ⸵น b3, b11

࠺࡯࠲ࡃࠬ

b5-b7, b13-b15

࡝࡯࠼

3 IREQ

⺒ߺ಴ߒኾ↪࿁〝

ILEVEL [0-7࡟ࡌ࡞]

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ഀࠅㄟߺఝవ

࡟ࡌ࡞್ቯ࿁〝 F/F

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IVECT࡝࡯࠼

IMASK࡜ࠗ࠻

ࠢ࡝ࠕ CPUࠦࠕ߳

࠮࠶࠻ EI

࿑ഀࠅㄟߺ೙ᓮ࡟ࠫࠬ࠲᭴ᚑ㧔࡟ࡌ࡞࠲ࠗࡊ㧕

(6)

RENESAS TECHNICAL UPDATE TN-32R-059A/JA 発行日： 2004 年 01 月 16 日

ページ箇所内容

Rev. C

で追加

（誤）

制約事項解除による最大ボーレートの訂正。

ボーレート

CSIOモード 152ビット/秒〜 2Mビット/秒 ( f(BCLK = 20MHz

動作時) )

UART

モード 19 ビット/秒〜156K ビット/秒 ( f(BCLK = 20MHz 動作時) )

12-3

表12.1.1

（正）ボーレート

CSIOモード 152ビット/秒〜

2Mビット/秒 ( f(BCLK = 20MHz

動作時) )

UART

モード 19 ビット/秒〜1.25M ビット/秒 ( f(BCLK = 20MHz 動作時) )

UART

使用時の

BRG(ボーレート)レジスタの設定値、制約事項の解除。

UART

モードの時には

BRG

が

7

以上となるように設定してください。

ボーレートジェネレータカウントソースとして

1

分周値( f(BCLK)そのもの ) を選択した場合、ボーレートレジスタには

7

以上の値を設定してください。

BRG

カウントソース (CDVI) で f(BCLK) を選択した場合、ボーレートレジスタ設定値は

7

以上という制限があります。

（誤）

クロックデバイダ分周比１を選択した場合、ボーレートレジスタ設定値は

7

以上という制限があります。

Rev. C

で追加

12-24, 12-42, 12-46, 12-53,

UART

使用時の

BRG

設定

値制約事項

（解除）

（正）＜削除＞

(7)

図

13.8.2 「リモートフレーム受信時のCAN

メッセージスロットコントロールレジ

スタの動作」中のレジスタの値を訂正 B'0110 1010

図13.8.2 リモートフレーム受信時のCANメッセージスロットコントロールレジスタの動作

13-82 図13.8.2

（誤）

（正） B'0110 1011

下記に訂正後の図

13.8.2 「リモートフレーム受信時のCAN

メッセージスロットコントロールレジスタの動作」を示します（下記図の部分）。

Rev. A で追加

B'0000 0000

ฃାⷐ᳞ࠢ࡝ࠕ

B'0000 1010

B'0110 0010

ฃା࠺࡯࠲ᩰ⚊

B'0000 0010

B'0000 0001

ฃା࠺࡯࠲ᩰ⚊ቢੌ

B'0110 1000

B'0110 1011

B'0110 0001 B'0110 0000

B'0111 1000

B'0000 1010

B'0000 0000

ฃାᓙߜ

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࠺࡯࠲ࡈ࡟࡯ࡓㅍା

B'0111 1011

B'0111 0000

ቢੌ

ฃାⷐ

᳞ࠢ࡝ࠕ ฃା࠺࡯࠲ᩰ⚊

ฃାⷐ᳞ࠢ࡝ࠕ H'60ᦠ߈ㄟߺ

(⥄േᔕ╵⸵น) H'70ᦠ߈ㄟߺ

(⥄േᔕ╵⑌ᱛ) TR RR Rm RL RA ML TRSTAT TRFIN

CANࡔ࠶࠮࡯ࠫࠬࡠ࠶࠻ࠦࡦ࠻ࡠ࡯࡞࡟ࠫࠬ࠲

年

01

月

16

日

Page 6 of 18

(8)

RENESAS TECHNICAL UPDATE TN-32R-059A/JA 発行日： 2004 年 01 月 16 日

ページ箇所内容

Rev. C

で追加

（誤）

以下の規格値、注釈の訂正。

注

3. RESET

端子以外はダブルファンクションとなっています。

21-5, 21-7

DC特性

（正）注

3. JTMS,JTRST,JTDI,RESET,FP,MOD0,1

端子以外はダブルファンクションとな

っています。

21-8

ページ

追加

0 10 20 30 40 50 60 70 80 90

2.4 2.5 2.6 2.7 2.8 2.9 3.0 3.1 3.2 3.3 3.4 3.5 3.6 3.7 3.8 3.9 4.0 4.1 VCCI(V)

ICCI(mA)

8MHz:25͠

90͠

110͠

130͠

10MHz:25͠

90͠

110͠

130͠

0 5 10 15 20 25 30 35

2.4 2.5 2.6 2.7 2.8 2.9 3.0 3.1 3.2 3.3 3.4 3.5 3.6 3.7 3.8 3.9 4.0 4.1 VCCI(V)

ICCI(mA)

8MHz:25͠

90͠

110͠

130͠

10MHz:25͠

90͠

110͠

130͠

21

21.1 㔚᳇⊛․ᕈ^{㔚᳇⊛․ᕈ}(VCCE=5Vᤨ)

ᮡḰࠨࡦࡊ࡞ߩICCI-3V᷷ᐲ․ᕈ(േ૞ᤨ : f=8MHz,10MHz)

ᵈ.VCCI=VDD=FVCC=OSCVCCޔVCCE=AVCC=5.0V

ᮡḰࠨࡦࡊ࡞ߩICCI-3V᷷ᐲ․ᕈ(RESETᤨ : f=8MHz,10MHz)

ᵈ.VCCI=VDD=FVCC=OSCVCCޔVCCE=AVCC=5.0V

21-8a Rev. C

で追加

(9)

RENESAS TECHNICAL UPDATE TN-32R-059A/JA 発行日： 2004 年 01 月 16 日

Page 8 of 18

ページ箇所内容

Rev. C

で追加

21-11, 21-19

A-D

変換特性

追加

以下の定格値を追加。

＜記号＞IIAN 、＜項目＞アナログリーク電流

＜測定条件＞

A-D

変換器が静止した状態における、AN0〜AN15 の入力リーク電流。

入力電圧の条件は

0≦ANi≦AVCC。温度条件はTa=−40〜85℃。

＜最小＞ -5μA 、＜最大＞ 5μA

Rev. C

で追加

21-20, 21-26

AC特性

追加

C6%.-

⸥ภ 㗄⋡ ⷙᩰ୯

ᦨዊ ᦨᄢ

න૏ ෳᾖ࿑⇟

࿑C

tw(TCLKH) tw(TCLKL)

TCLKH ౉ജ*ࡄ࡞ࠬ᏷

TCLKH ౉ജ.ࡄ࡞ࠬ᏷

ns ns

[99]

[100]

7 x^tc(BCLK)₂ 7 x^tc(BCLK)₂

TCLK

[99] tw(TCLKH)

[100] tw(TCLKL)

0.8VCCE 0.2VCCE

࿑C6%.-࠲ࠗࡒࡦࠣ

(10)

RENESAS TECHNICAL UPDATE TN-32R-059A/JA 発行日： 2004 年 01 月 16 日

ページ箇所内容

（誤）ポートデータ出力タイミングを訂正。

ࡐ࡯࠻಴ജ

td(E-P)

0.8VCCE 0.2VCCE

BCLK

0.8VCCE 0.2VCCE 0.8VCCE

0.2VCCE

ࡐ࡯࠻౉ജ

0.2VCCE 0.8VCCE

tsu(P-E) th(E-P)

1 2

3

21.3.3 AC․ᕈ

࿑21.3.1 ౉಴ജࡐ࡯࠻࠲ࠗࡒࡦࠣ

Rev. C

で追加

21-26

図

21.3.1

（正）

ࡐ࡯࠻಴ജ ^0.8VCCE0.2VCCE

BCLK

0.8VCCE 0.2VCCE 0.8VCCE

0.2VCCE

ࡐ࡯࠻౉ജ

0.8VCCE

tsu(P-E) th(E-P)

1 2

td(E-P) 3

21.3.3 AC․ᕈ

࿑21.3.1 ౉಴ജࡐ࡯࠻࠲ࠗࡒࡦࠣ

(11)

ページ箇所内容 Rev. B

で追加

付録ページ

4-24 差し替え

ઃ㍳ 4

ઃ㍳4-24

ᵈᗧ੐㗄ߩ߹ߣ߼

ઃ㍳4.13ޓࡁࠗ࠭ߦ㑐ߔࠆᵈᗧ੐㗄

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࿁〝

VSS

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年

01

月

16

日

Page 10 of 18

(12)

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⊒ᝄ↪ߩVSSࡄ࠲࡯ࡦߪࡌ࠲ࡄ࠲࡯ࡦߣߒߡGNDߦធ࿾ߊߛߐ޿ޕ

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ઃ࿑4.13.2ޓࠢࡠ࠶ࠢ౉಴ജ┵ሶߩ㈩✢଀

OSC-VSS XIN XOUT VSS

ࡁࠗ࠭

ᄥߊ⍴޿㈩✢

⚦ߊ㐳޿㈩✢

OSC-VSS XIN XOUT VSS 付録ページ

4-25 差し替え

Rev. B で追加

年

01

月

16

日

(13)

ઃ㍳ 4

ઃ㍳4-26

ᵈᗧ੐㗄ߩ߹ߣ߼

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෶ߪVSS┵ሶߣࠍធ⛯ߔࠆ႐วޔേ૞ࡕ࡯࠼⸳ቯ┵ሶߣVCC෶ߪVSS┵ሶߣߩ㑆ߦࡁࠗ࠭ߦࠃࠆ㔚૏

Ꮕ߇↢ߓࠆߣേ૞ࡕ࡯࠼߇ਇ቟ቯߣߥࠅޔ⺋േ૞߿᥸⿛ߩේ࿃ߣߥࠅ߹ߔޕ

ઃ࿑4.13.3ޓVCNT┵ሶߩ㈩✢଀ޓޓ 㧔3㧕VCNT┵ሶߩ㈩✢

VCNT┵ሶߦធ⛯ߔࠆ㈩✢ߪޔߢ߈ࠆߛߌᄥߊ⍴ߊߒߡߊߛߐ޿ޕ

VCNTߦធ⛯ߔࠆࠦࡦ࠺ࡦࠨߩធ࿾↪࡝࡯࠼✢ߣࡑࠗࠦࡦߩOSC-VSS┵ሶߣߪᦨ⍴ߢធ⛯ߒߡߊߛߐ޿ޕ VCNT↪ߩVSSࡄ࠲࡯ࡦߪࡌ࠲ࡄ࠲࡯ࡦߣߒߡGNDߦធ࿾ߊߛߐ޿ޕ

<ℂ↱>

VCNT┵ሶߩᄖઃߌ࿁〝ߪޔ៞タߐࠇߡ޿ࠆPLLߩౝㇱ㔚࿶ߩ቟ቯൻߣࡁࠗ࠭㒰෰ߣߒߡߩࡠ࡯ࡄࠬ

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OSC-VSS VCNT VSS

VSS VSS

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付録ページ

4-26 差し替え

Rev. B で追加

年

01

月

16

日

Page 12 of 18

(14)

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月

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Rev. B で追加

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Rev. B で追加

年

01

月

16

日

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TECHNICAL UPDATE グループユーザーズマニュアル正誤表 （Rev. C）

お客様各位

カタログ等資料中の旧社名の扱いについて

ルネサスエレクトロニクス ホームページ（http://www.renesas.com）

2010 年 4 月 1 日

ルネサスエレクトロニクス株式会社

【発行】ルネサスエレクトロニクス株式会社（http://www.renesas.com）

【問い合わせ先】http://japan.renesas.com/inquiry

発行日： 2004 年 01 月 16 日

RENESAS TECHNICAL UPDATE

〒 100-0004 東京都千代田区大手町 2-6-2 日本ビル 株式会社 ルネサス テクノロジ

問合せ窓口 E-mail: [email protected] 製品分類

発行番号 TN-32R-059A/JA

第１版

題

名

グループユーザーズマニュアル正誤表（

）

情 報 分 類

ドキュメント訂正追加等

対象ロット等 適

用 製 品

グループ

−−

関 連 資 料

グループ

ユーザーズマニュアル

年

月に発行されました「

グループユーザーズマニュアル

」に、内容の訂正がありましたので

お知らせいたします。

グループユーザーズマニュアル

をご利用の際は、添付の正誤表をご使用ください。

なお、添付の正誤表（

）には、同マニュアルの正誤表（

）と正誤表（

）の内容も記載しています。

・［ニュース

］：正誤表（

）

・［ニュース

］：正誤表（

）

添付資料：

グループユーザーズマニュアル正誤表（

）

枚

RENESAS TECHNICAL UPDATE TN-32R-059A/JA 発行日： 2004 年 01 月 16 日

ページ 箇所 内容

（誤） 何も配置されていません

書き込み時の条件： 書き込み無効

で追加

全章 未配置 ビットの 処理

（正） 何も配置されていません。”0”に固定してください。

書き込み時の条件： 常に

を書き込む

年

月

日

注意書きの内容（下線部分）を訂正。

注意書きの内容（下線部分）を訂正。

ヘッダー部に記載の節題を訂正 7.3 リセット解除直の内部状態

7.3 リセット解除後の内部状態

RENESAS TECHNICAL UPDATE TN-32R-059A/JA 発行日： 2004 年 01 月 16 日

ページ 箇所 内容

で追加

トの注釈 追加

割り込み制御レジスタ IREQ（割り込み要求）ビットの注釈に以下を追記。

注. ・IREQ ビットをクリアしても、CPU コアへの割り込み要求(EI)は、クリアさ れません。CPU コアへの割り込み要求(EI)は、次の動作によってのみクリア されます。

（１）リセット

（２）IVECT レジスタの読み出し

（３）IMASK レジスタへの書き込み

で追加

図

図

差し替

え

RENESAS TECHNICAL UPDATE TN-32R-059A/JA 発行日： 2004 年 01 月 16 日

ページ 箇所 内容

TECHNICAL UPDATE グループユーザーズマニュアル正誤表（Rev. C）

ルネサスエレクトロニクスホームページ（http://www.renesas.com）

〒 100-0004 東京都千代田区大手町 2-6-2 日本ビル株式会社ルネサステクノロジ

^第１版

情報分類

対象ロット等適

用製品

関連資料

ページ箇所内容

（誤）何も配置されていません

書き込み時の条件：書き込み無効

全章未配置ビットの処理

（正）何も配置されていません。”0”に固定してください。

書き込み時の条件：常に

ページ箇所内容

トの注釈追加

注. ・IREQ ビットをクリアしても、CPU コアへの割り込み要求(EI)は、クリアされません。CPU コアへの割り込み要求(EI)は、次の動作によってのみクリアされます。

ページ箇所内容

（正）ボーレート

カウントソース (CDVI) で f(BCLK) を選択した場合、ボーレートレジスタ設定値は

以上という制限があります。

使用時の

値制約事項

（正）＜削除＞

メッセージスロットコントロールレジスタの動作」を示します（下記図の部分）。

ページ箇所内容

（正）注

ページ箇所内容

＜最小＞ -5μA 、＜最大＞ 5μA

ページ箇所内容

（誤）ポートデータ出力タイミングを訂正。