電源電圧

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LV8760T

概要

LV8760Tは、正転、逆転、ブレーキ、待機の4モードをコントロールできるHブリッジドライバである。

スタンバイ電流ゼロ、低ON抵抗で高効率を実現し、OA用のブラシ付きDCモータの駆動に最適である。

特長

・正逆Hブリッジドライバ 1ch

・電流リミッタ機能内蔵

・サーマルシャットダウン回路内蔵

・短絡保護機能内蔵

絶対最大定格/Ta=25℃

項目 記号 条件 定格値 unit

VM max 38 V

電源電圧

VCC max 6 V

出力ピーク電流 IO peak tw≦20ms,duty 5% 4 A

出力連続電流 IO max 3 A

ロジック入力電圧 VIN －0.3～VCC＋0.3 V

許容消費電力 Pd max 指定基板付き※ 3.3 W

動作周囲温度 Topr －20～＋85 ℃

保存周囲温度 Tstg －55～＋150 ℃

※ 指定基板:90mm×90mm×1.6mm,ガラスエポキシ2層基板(2S0P),裏面実装有り

推奨動作範囲/Ta=25℃

項目 記号 条件 定格値 unit

VM 9～35 V

電源電圧範囲

VCC 3～5.5 V

VREF入力電圧 VREF 0～VCC－1.8 V

ロジック入力電圧 VIN 0～VCC V

Bi-CMOS 集積回路

正逆 H ブリッジドライバ

最大定格を超えるストレスは、デバイスにダメージを与える危険性があります。最大定格は、ストレス印加に対してのみであり、推奨動作条件を超えての機能 的動作に関して意図するものではありません。推奨動作条件を超えてのストレス印加は、デバイスの信頼性に影響を与える危険性があります。

電気的特性/Ta=25℃,VM=24V,VCC=5V,VREF=1.5V

項目 記号 条件 min typ max unit

全体

待機時消費電流1 IMst PS= “ L ” 1 μ A

待機時消費電流2 ICCst PS= “ L ” 1 μ A

動作時消費電流1 IM PS=“H”,IN1=“H”,無負荷 1 1.3 mA

動作時消費電流2 ICC PS=“H”,IN1=“H”,無負荷 3 4 mA

VREG出力電圧 VREG IO=－1mA 4.75 5 5.25 V

VCC低電圧カット電圧 VthVCC 2.5 2.7 2.9 V

低電圧ヒステリシス電圧 VthHIS 120 150 180 mV

サーマルシャットダウン温度 TSD 設計保証 ※ 155 170 185 ℃

サーマルヒステリシス幅 Δ TSD 設計保証 ※ 40 ℃

出力部

Ron1 IO=3A、シンク側 0.2 0.25 Ω

出力オン抵抗

Ron2 IO=－3A、ソース側 0.32 0.40 Ω

出力リーク電流 IOleak VO=35V 50 μ A

立ち上がり時間 tr 10%～90% 200 500 ns

立ち下がり時間 tf 90%～10% 200 500 ns

tpLH IN1 or IN2～OUTA or OUTB (L → H)

550 700 ns 入出力遅延時間

tpHL IN1 or IN2～OUTA or OUTB (H → L)

550 700 ns

昇圧電圧 VGH VM=24V 28.0 28.7 29.8 V

立ち上り時間 tONG VG=0.1 μ F 250 500 μ s

発振周波数 Fcp 115 140 165 kHz

制御入力部

IINL VIN=0.8V 適応端子:PS 5.6 8 10.4 μ A ロジック端子入力電流1

IINH VIN=5V 適応端子:PS 56 80 104 μ A IINL VIN=0.8V 適応端子:IN1,IN2 5.6 8 10.4 μ A ロジック端子入力電流2

IINH VIN=5V 適応端子:IN1,IN2 35 50 65 μ A

ロジック入力“H”レベル電圧 VINH 適応端子:PS,IN1,IN2 2.0 V

ロジック入力“L”レベル電圧 VINL 適応端子:PS,IN1,IN2 0.8 V

電流Limit部

VREF入力電流 IREF －0.5 μ A

電流Limitコンパレータ スレッショルド電圧

Vthlim VREF=1.5V 0.285 0.3 0.315 V

ブランキング時間 TBLK 1.6 2.0 2.4 μ s

短絡保護部

SCP端子充電電流 Iscp SCP=0V 3.5 5 6.5 μ A

コンパレータスレッショルド 電圧

Vthscp 0.8 1 1.2 V

※設計保証値であり、測定は行わない。

外形図

unit:mm (typ) 3279

ピン配置図

6.4

0.65

4.4

(0.33)

(1.0)

6.5

0.5

0.15

1 10

20 11

0.22

0.08 1.2max SIDE VIEW

BOTTOM VIEW

Exposed Die-Pad TOP VIEW

SANYO : TSSOP20J(225mil)

1 PGND

2 OUTB

3 OUTB

4 RNF

5 RNF

6 VM

7 VM

8 OUTA

9 OUTA

10 PS

20 VCC 19 SCP 18 VREF 17 IN2 16 IN1 15 REG5 14 CP1 13 CP2 12 VG 11 GND

L V8760T

基板仕様(LV8760T動作推奨基板)

サイズ :90mm×90mm×1.6mm(2層基板[2S0P]) 材質 :ガラスエポキシ

銅配線密度 :L1=95%/L2=95%

L1:銅配線パターン図 L2:銅配線パターン図

注意事項

1)Exposed Die-Pad基板実装ありのデータは、Exposed Die-Pad面が90%以上濡れた状態での値である。

2)セット設計は余裕を持ったディレーティング設計をお願いする。

ディレーティングの対象になるストレスは、電圧、電流、接合部温度、電力損失、それに機械的 ストレスとして、振動、衝撃および引張りなどがある。

したがって設計に当っては、これらのストレスをできるだけ低く、あるいは小さくすること。

一般的なディレーティングの目安を示す。

(1)電圧定格に対して、最大値が80%以下 (2)電流定格に対して、最大値が80%以下 (3)温度定格に対して、最大値が80%以下

3)セット設計後は、必ず製品で検証を行うこと。

また、Exposed Die-Pad等 半田接合状態の確認、および、半田接合部の信頼性検証を行うこと。

これらの部分の半田接合にボイドや劣化が認められる場合、基板への熱伝導状態が悪くなり、IC の熱破壊に至る可能性がある。

PCA02874

Pd max – Ta

0 1.0 1.60 2.0 3.0 3.30 4.0

1.72

0.83

– 20 0 20 40 60 80 100

ブロック図

TSD LVS PS VCC GND

+ -

VM

+ -

VGCP2 REG5 SCP

CP1OUTBOUTARNF PGND VREF IN1IN2

M +-

+-

端子機能

端子

No. 端子名 端子機能 等価回路図

16 17

IN1 IN2

出力制御信号入力端子1 出力制御信号入力端子2

VCC

GND

10kΩ

100kΩ

10 PS パワーセーブ信号入力端子

50kΩ 50kΩ

10kΩ 10kΩ

GND VCC

18 VREF 出力電流リミット設定用 基準電圧入力端子

GND VCC

500Ω

19 SCP 短絡保護回路 検出時間設定 用コンデンサ接続端子

500Ω

GND VCC

20 VCC コントロール電源端子

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端子

No. 端子名 端子機能 等価回路図

6,7 8,9 4,5 2,3 1

VM OUTA RNF OUTB PGND

モータ電源接続端子 OUTA出力端子

電流センス抵抗接続端子 OUTB出力端子

パワーGND

REG5

GND

500Ω 500Ω

3 2 6 7

9 8

1 4 5

14 13 12

CP1 CP2 VG

チャージポンプ用コンデンサ 接続端子

チャージポンプ用コンデンサ 接続端子

チャージポンプ用コンデンサ 接続端子

100Ω

GND REG5

14 6 7 13 12

15 REG5 内部基準電圧出力端子

GND VM

2kΩ

25kΩ

74kΩ

11 GND グランド端子

DCモータドライバ 1.DCM出力制御ロジック

制御入力 出力

PS IN1 IN2 OUTA OUTB モード

L ＊ ＊ OFF OFF 待機

H L L OFF OFF 出力OFF

H H L H L CW(正転)

H L H L H CCW(逆転)

H H H L L ブレーキ

2.電流LIMIT制御タイムチャート

toff

SLOW CHARGE

OUTA

OUTB

SCP端子－GND間にCを接続することにより、電流リミット動作時のブレーキ動作時間の設定を行うこ とができる。

この設定は、【出力短絡保護機能】の出力短絡時における出力OFFまでの時間設定と共通となってい る。

設定方法は、【出力短絡保護機能】の項を参照する。

3.電流LIMIT設定方法

DCMドライバの電流リミット値は、VREF電圧とRNF-GND間に接続する抵抗(RNF)から下記の式で決定さ れる。

Ilimit[A]=(VREF[V]/5)/RNF[

Ω

VREF=1.5V,RNF=0.2

Ω

Ilimit=1.5V/5/0.2

Ω

出力短絡保護機能

出力が天絡、地絡などによってショートした場合、ICが破壊してしまうことを防止するために出力 をOFFさせる出力短絡保護回路が内蔵されている。

1.保護機能動作(ラッチ方式)

出力ショート状態を検知すると、短絡検出回路が動作する。

短絡状態が、内部タイマ(≒4

μ

その後、後述のタイマーラッチ時間を越えたところで、再度出力をONさせて、それでも短絡状態を 検出した場合は、すべての出力を待機モードに切り替え、その状態を保持する。この状態は、PS=“L”

にすることによって解除される。

4μs

2.SCP端子定数設定方法(タイマーラッチ設定)

SCP端子－GND間にCを接続することにより、出力短絡時に出力OFFまでの時間設定を行うことができ る。Cの値は、以下の式により決定する。

タイマラッチ:Tscp Tscp≒C・V/I [s]

V:比較器スレッショルド電圧 TYP 1V I:SCP充電電流 TYP 5

μ

例えば、SCP端子－GND間に、C=50pFのコンデンサを接続した場合、

Tscp=50pF×1V/5

μ

μ

応用回路例

(電流リミット機能を使用した場合)

電流Limit設定 VCC=5Vの時

Vref=1.5V

Ilimit=Vref/5/RNF

=1.5V/5/0.22

Ω

電流リミット回生時間、短絡状態検出時間設定 Tscp≒C・V/I

=100pF・1V/5

μ

=20

μ

1 PGND 2 OUTB 3 OUTB 4 RNF 5 RNF 6 VM 7 VM 8 OUTA 9 OUTA 10 PS

VCC 20 19 SCP

18 VREF

17 IN2

16 IN1

15 REG5

14 CP1

13 CP2

12 VG

11 GND

L V8760T

0.22Ω

35kΩ

M

15kΩ

100pF + -

- + 10μF

0.1μF

0.1μF

0.1μF 0.1μF

1 PGND 2 OUTB 3 OUTB 4 RNF 5 RNF 6 VM 7 VM 8 OUTA 9 OUTA 10 PS

VCC 20 19 SCP

18 VREF

17 IN2

16 IN1

15 REG5

14 CP1

13 CP2

12 VG

11 GND

L V8760T

M

100pF + -

- +

(電流リミット機能を使用しない場合)

短絡状態検出時間設定 TSCP≒C・V/I

=100pF・1V/5µA

=20µs

※電流リミット機能を使用しない場合、下記の処理をすること。

・RNF-GND間ショート

・VREF端子をVCC以下の適当な電位に吊る

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(参考訳)