最大出力電流

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LV8063FA

概要

LV8063FAは、単相ファンモータ用のドライバICで、BTLリニア出力方式により無効電力を抑制する ことで、高効率、低電力及び低ノイズでの駆動を行っている。BTL出力を外部信号によってPWM制御 と組み合わせることが出来るので、低消費電力、低ノイズを要求されるノートPCのCPUクーラなど に最適である。

特長

・BTL出力 (BTLアンプゲイン:43dB) 方式の単相全波駆動 ・PWM入力による速度制御可能

・ホールバイアス出力端子付(VHB=1.05V typ) ・クイックスタート回路内蔵

・FG(回転信号)出力ターミナル(オープンドレイン出力) ・起動補償回路内蔵

・ロック保護回路、および自動復帰回路内蔵

・サーマルシャットダウン(TSD)回路内蔵

絶対最大定格/Ta=25℃

項目 記号 条件 定格値 unit

最大電源電圧 VCC max 7 V

IOUT max1 定常 0.7 A

最大出力電流

IOUT max2 ロック検出時 1 A

出力耐圧 VOUT max 7 V

FG出力耐圧 VFG max 7 V

FG出力最大電流 IFG max 5 mA

HB出力最大電流 IHB max 10 mA

Pd max1 IC単体 0.2 W

許容損失

Pd max2 指定基板 ※ 0.4 W

接合部温度 Tj max ＋150 ℃

動作温度 Topr －30～＋95 ℃

保存温度 Tstg －55～＋150 ℃

※ 指定基板:20mm×10mm×0.8mm,紙フェノール

注 1)絶対最大定格は、一瞬でも超えてはならない許容値を示すものである。

注2)絶対最大定格の範囲内で使用した場合でも、高温及び大電流/高電圧印加、多大な温度変化等で連続して使 用される場合、信頼性が低下するおそれがある。詳細については、弊社窓口までご相談ください。

Bi-CMOS

ファンモータ用 単相全波ドライバ

最大定格を超えるストレスは、デバイスにダメージを与える危険性があります。最大定格は、ストレス印加に対してのみであり、推奨動作条件を超えての機能 的動作に関して意図するものではありません。推奨動作条件を超えてのストレス印加は、デバイスの信頼性に影響を与える危険性があります。

推奨動作範囲/Ta=25℃

項目 記号 条件 定格値 unit

VCC opg 全回路動作 2.5～6.0 V

電源電圧

VCC min PWM=H, 起動動作 2.2～6.0 V

ホール入力同相入力電圧範囲 VICM 0.3～VCC-1.5 V

電気的特性/Ta=25℃,VCC=5V

項目 記号 条件 min typ max unit

ICC 動作時 1.5 3.0 mA

回路電流

ICCO 待機時 200 300 μ A

HBバイアス電圧 VHB IHB=5mA 0.9 1.05 1.2 V

ホール入力バイアス電流 IHIN 1 μ A

出力ON電圧 VO IO=250mA,source＋sink 0.25 0.35 V ホールアンプ入力

オフセット電圧

VINOFS -6 6 mV

ホールアンプ電圧利得 GH 39 43 47 dB

PWM端子入力『L』レベル VPWML 0 0.7 V

PWM端子入力『H』レベル VPWMH 2.5 VCC V

PWM入力周波数 fPWM 設計保証 ※ 20 50 kHz

PWM入力最小パルス幅 TPWM 設計保証 ※ 5 μ s

FG出力端子『L』電圧 VFG IFG=3mA 0.3 V

FG出力端子リーク電流 IFGL VFG=7V 10 μ A

FGコンパレータ ヒステリシス幅

ΔVHYS ± 5 ± 15 ± 20 mV

ロック検出時出力ON時間 TACT 0.45 0.6 0.75 sec

ロック検出時出力OFF時間 TDET 4.5 6 7.5 sec

ロック検出ON/OFF比 TRTO TRTO=TDET/TACT 8 10 11 サーマルシャットダウン

動作温度

TSD 設計保証 ※ 180 ℃

サーマルシャットダウン ヒステリシス幅

Δ TSD 設計保証 ※ 40 ℃

※設計保証：設計目標値であり、これらの項目は測定を行わない。

ピン配置図

1

IN1 10 PWM

外形図

unit:mm (typ) 3428

ブロック図

Pd max -- Ta

0 0.3 0.4

0.2

0.1 0.5

--30 --10 10 30 50 70 90 110

0.18

0.09

1

IN1

2

HB

3

IN2

4

SGND

5

PGND

10

9

8

7

OUT1

PWM

FG

VCC

+ -

OUT2

+-

TSD

ENABLE

CONTROL

LOCK DETECTION

HB

LEVEL OSC SHIFT SANYO : Micro10

3.0

0.25 0.16

0.5

4.91.03

0.13.0 0.55

1 10

2

応用回路

*1 接続を逆にしたことで装置が破壊されるのを防止するためにダイオードDiを使用する場合、キャ パシタCrを挿入し、回生電流ルートを確保するようにすること。

同様に、ファン電源ライン上でキャパシタが近くにない場合も、信頼性向上のためにCrが必要に なる。

*2 ホール素子は、HB端子からの定電圧(約1.05V)でバイアスすることにより、温度特性の優れた、

安定したホール信号を出力する。ホール出力の振幅調整が必要な場合、図のように抵抗R1を使用 すること。また、HB端子を使用しない場合は、1k～10kΩ程度で対GNDへプルダウンすること。

*3 ホール出力からICのホール入力への配線が長い場合、配線にノイズがのることがある。この場合、

図のように、キャパシタを挿入すること。

*4 FG端子を使用しない場合、オープンにすること。

*5 PWM信号がオープンコレクタ(ドレイン)出力の場合、H(L)レベルが決定されるように、適当なプ ルアップ(プルダウン)抵抗を接続すること。

1 2 3 4 5

10 PWM

HB FG 9

IN2 VCC 8

SGND OUT2 7 OUT1 PGND 6 IN1

M H ^R1

*3

*2

*5 *4

Cr Di

*1

端子説明

端子

番号 端子記号 電圧 端子説明 等価回路

1 IN1 ホール入力端子(＋)

3 IN2 －

ホール入力端子(－)

3

2 HB 1.05V(typ) ホールバイアス出力端子

2

4 SGND 0V シグナルGND端子 5 OUT1

7 OUT2 － モータ駆動用出力端子

7

6 PGND 0V パワーGND端子 8 VCC 2.5V～6.0V 電源電圧入力端子

9 FG － FGパルス出力端子

9

10 PWM － PWM信号入力端子

10

タイミングチャート 待機/起動 切り替え

*TSLP = 800

μ

*PWM信号がTSLPの間、連続して『L』レベルの場合、これを検出して待機モードになる。

*『H』レベルの入力の場合、直ちにアクティブモードになる。

定常回転時

*定常回転時の真理値表

IN1 IN2 PWM OUT1 OUT2 FG モード

VCC

PWM

HB

OUT1/OUT2

TSLP TSLP

(Hi-Impedance)

IN1-IN2 HYS

OUT1

OUT2

FG

HYS

PWM

モータロック時

*モータロック保護動作時は、OUT1,OUT2とも

“

”

起動補償回路動作時(PWM端子=H)

*電源投入時・スタンバイ解除(クイックスタート)時・ロック保護解除時に起動補償動作を行う。

VCC

IN1-IN2

PWM

OUT1

OUT2

FG

OUT1 IN1-IN2

TACT ( = 0.6S (typ)) TACT ( = 6S (typ)) OUT2

FG

起動補償回路動作時(PWM端子=PWM信号入力)

*電源投入時・スタンバイ解除(クイックスタート)時・ロック保護解除時に起動補償動作を行う。

VCC IN1-IN2 PWM OUT1

OUT2

FG

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