1. 概 要 AP1355AEM は、ホール素子用アンプです。ホール素子に電流を供給する電流源、ホール素子の出力電 圧を増幅するアンプを内蔵しています。また、外部電圧によりホール素子の駆動電流、オフセット電圧 を調整でき、ホール素子の素子ばらつき、および、ホール素子設置時の取り付け誤差を補正することが 可能です。 2. 特 長 入力電圧範囲 ±13.5V ~ ±15V ~ ±16.5V 動作温度範囲 −40°C ~ 105°C ホール素子用出力電流源 5mA±5.4% @ Ta= 25°C (+0.045%/°C) アンプゲイン Gain A ×180 Gain B ×95 オフセット電圧調整可能 調整範囲 ±1.85V(typ)、調整精度 ±2.0mV 基準電圧内蔵 5.0V±2% @ Ta= 25°C 出力ドライブ能力 ±10mA パッケージ 16-pin TSSOP ESD耐圧 HBM = ±2.0kV
AP1355AEM
ホール素子用アンプ
015007471-J-00 2015/063. 目 次 1. 概 要 ... 1 2. 特 長 ... 1 3. 目 次 ... 2 4. ブロック図と機能説明 ... 3 5. オーダリングガイド ... 4 6. ピン配置と機能説明 ... 4 7. 絶対最大定格 ... 5 8. 推奨動作条件 ... 5 9. 電気的特性 ... 6 10. 機能説明 ... 9 11. パッケージ ... 11 12. 改訂履歴 ... 12
4. ブロック図と機能説明 ■ ブロック図 4 12 11 10 3 5 15 2 1 8 16 -15V +15V VREF GND VEE VO VCC ISET IHALL IN-TR1 TR2 N.C. IN+ 3.3k 13 14 VOS VISET Offset calibration Circuit Voltage Reference AK9820C 1 2 3 4 8 7 6 5 AO1 AO2 CS VCC SK DI DO GND HG -362 A 1 4 3 2 7 9 N.C. N.C. CS SK DO DI 6 1.0uF 1.0uF 100 1000pF 2200pF CIN RISET CVCC CVEE CVREF 0.1uF 10k 10k 10k Amplifier Gain set Circuit Current mirror Circuit
Figure 1. Block Diagram
■ 機能説明 ブロック 機能 増幅回路 ホール起電圧を増幅します。 TR1~TR2の端子間を短絡させることにより、倍率変更可能です。 オフセット調整回路 増幅回路出力のオフセットを調整します。 VOS端子に印加する電圧により、オフセットを調整できます。 基準電圧回路 基準電圧(5V)を出力します。 外付けされるD/Aコンバータに電圧(電源)を供給します。 駆動電流回路 ホール素子に電流を供給します。 電流はVISETピンに印加する電圧により可変できます。 ■ D/A コンバータ (AK9820CTH) オフセット調整回路に電圧を印加、及びホール電流設定に使用します。 015007471-J-00 2015/06
5. オーダリングガイド AP1355AEM −40°C ~ 105°C 16-pin TSSOP
6. ピン配置と機能説明 ■ ピン配置
7
14
15
16
5
6
13
11
8
1
3
12
VREF
GND
N.C.
TR1
VCC
ISET
IHALL
IN-VO
N.C.
N.C.
IN+
9
10
VOS
VISET
2
4
VEE
TR2
■ ピン機能説明No. Pin Name I/O Description
1 VCC I 正側の電源端子です。
2 ISET I 外付け抵抗RISETを接続し、ホール素子駆動電流を設定する端子です。
3 IHALL O
ホール素子に電流を供給する端子です。
ホール素子駆動電流は以下の式で計算できます。
IIHALL=VVISET÷RISET×3
4 IN+ I ホール信号の入力端子です。HG-362AのOUT+を接続します。 5 IN- I ホール信号の入力端子です。HG-362AのOUT-を接続します。 6 VO O 出力端子です。 7 N.C. - 未接続端子です。 8 N.C. - 未接続端子です。 9 VEE I 負側の電源端子です。 10 N.C. - 未接続端子です。 11 TR2 I ゲイン設定端子です。 12 TR1 I ゲイン設定端子です。 13 VOS I オフセット電圧の調整端子です。AK9820CTHのAO1を接続します。 14 VISET I ホール素子駆動電流の調整端子です。AK9820CTHのAO2を接続します。 15 VREF O 基準電圧端子です。AK9820CTHのVCCに接続します。 16 GND - GND端子です。 Note 1. TR1-TR2をショートする場合は1Ω以下でショートして下さい。
7. 絶対最大定格
Parameter Symbol min max Units Condition
電源電圧 VCC GND +18 V VEE -18 GND V 入力端子 IN-, IN+, TR1,TR2, VOS VEE VCC V VISET GND VCC V 出力端子 VO VEE VCC V ISET, IHALL, VREF GND VCC V 保存温度 TSTG -55 +150 °C ジャンクション温度 TJ 125 °C 許容損失 (Note 3) PD 200 mW Ta=105°C Note 2. 電圧は全てGNDピンに対する値です。 Note 3. PKGの熱抵抗 (θJA): 112.6°C/W (JEDEC51準拠の4層基板) 注意:この値を超えた条件で使用した場合、デバイスを破壊することがあります。また、通常の動作は 保証されません。 8. 推奨動作条件
Parameter Symbol min typ max Units
電源電圧+ VCC 13.5 15 16.5 V 電源電圧- VEE -16.5 -15 -13.5 V 動作温度 TOPR -40 25 105 °C VO負荷容量 CVO - - 470 pF VREF負荷容量 CVREF - 0.1 0.47 µF VCC接続容量 CVCC 0.47 1.0 - µF VEE接続容量 CVEE 0.47 1.0 - µF 入力容量 CIN 1650 2200 2750 pF 注意:本データシートに記載されている条件以外のご使用に関しては、当社では責任を負いかねますの で、十分ご注意下さい。 015007471-J-00 2015/06
9. 電気的特性
特記無き場合は、Ta=-40°C ~105°C、VCC=13.5V~16.5V、VEE= -VCCの条件になります。
Parameter Symbol min typ max Units Conditions
消費電流 ICC - 9.0 11.0 mA RISET=3.00kΩ, VVISET=5.0V
VVOS=2.5V, HE:HG-362A
IEE - -2.0 -3.0 mA
起動時消費電流 ICC - - 11.0 mA VCC,VEE=0~±16.5V, ISET=3.00kΩ
VVISET= VVREF=VVOS, HE:HG-362A
IEE - - -3.0 mA
基準電圧特性
基準電圧 (25°C) VREF 4.9 5.0 5.1 V
IVREF=0mA, VVISET=5.0V
VVOS=2.5V, RISET=3.00kΩ, Ta=25°C
起動時基準電圧 VREF -0.6 - 6.5 V
基準電圧温度特性 ∆VREF -100 0 +100 ppm/°C
IVREF=0mA, VVISET=5.0V
VVOS=2.5V, RISET=3.00kΩ
負荷変動 LoReg
VREF
- - 100 mV IVREF=0 to 5.5mA, VVISET=5.0V VVOS=2.5V, RISET=3.00kΩ ISETピン
ISET端子
オフセット電圧 VISETO -50 -10 5 mV
VISETO = VISET-VVISET, RISET=2.7kΩ~
7.5kΩ, VVISET=0.9V~5.2V, VVOS=2.5V ISET端子電圧 負荷変動 LoReg ISET - - 50 mV RISET=2.7kΩ~7.5kΩ, VVISET=0.9V~ 5.2V, VVOS=2.5V ホール素子駆動電流 HALL電流
(25°C) IHALL 4.73 5.0 5.27 mA IIHALL= VVISET /RISET ×3, RISET
= 3.00kΩ,
VVISET= VVREF, VVOS=2.5V, Ta=25°C
HALL電流
(105°C) IHALL105 4.76 5.18 5.59 mA
IIHALL= VVISET /RISET ×3
RISET=3.00kΩ, RISET 温度特性
=0ppm/°C, VVISET=VVREF, VVOS=2.5V
HALL電流
(-40°C) IHALL-40 4.46 4.85 5.24 mA
IIHALL= VVISET /RISET ×3
RISET=3.00kΩ, RISET 温度特性
=0ppm/°C, VVISET=VVREF, VVOS=2.5V
HALL電流 温度特性 ∆IHALL 200 450 700 ppm/°C VVISET=0.9V~5.2V, VVOS=2.5V RISET=2.7kΩ~7.5kΩ, ISETピン電流 HALL電流 比 (25°C) IHALL / IISET 2.90 3.0 3.10 - VVISET=0.9V~5.2V, VVOS=2.5V, RISET=2.7kΩ~7.5kΩ, Ta=25°C
最大HALL電流 IHALL MAX 5.8 - - mA RISET=1.0kΩ, RIHALL=1.92kΩ
特記無き場合は、Ta=-40°C ~105°C, VCC=13.5V~16.5V, VEE= -VCCの条件になります。
Parameter Symbol min typ max Units Conditions アンプ部(オフセット調整) 出力電圧A VOS_A -0.20 0 0.20 V VVOS=1/2VREF, TR1-TR2=0Ω VIN+=VIN-= 0~4V, IVO =0mA VVISET=5.0V 出力電圧B VOS_B 1.65 1.85 2.05 V VVOS=0V, TR1-TR2=0Ω VIN+=VIN-= 0~4V, IVO =0mA VVISET=5.0V 出力電圧C VOS_C -2.05 -1.85 -1.65 V VVOS=VREF, TR1-TR2=0Ω VIN+=VIN-= 0~4V, IVO =0mA VVISET=5.0V アンプ部(DC) 入力バイアス 電流 IIB - -15 -70 nA VIN+=VIN-= 0~7.5V 入力オフセット 電流 IIO - ±1.5 ±30 nA VIN+=VIN-= 0~7.5V 同相入力 電圧範囲 VICR VCC -3.0 VCC -2.0 - V CMR > 80dB, (Ta=25°C~105°C) CMR > 75dB, (Ta=-40°C~25°C未 満) Gain=180, IVO =0mA - VEE +2.0 VEE +3.0 V 最大出力 電圧範囲 VOM VCC -3.0 - - V RL =2kΩ - - VEE +3.0 V
出力電流 IO SINK 10 - - mA VIN+=2V, VIN-=3V, VVO=0V
IO SOURCE - - -10 mA VIN+=3V, VIN-=2V, VVO=0V
アンプ部(DC2)
アンプゲインA Gain A TYP
-5% 180
TYP
+5% 倍
TR1-TR2=0Ω, VVO=±4.0V
IVO =0mA
アンプゲインA Gain A TYP
-5% 180 TYP +5% 倍 TR1-TR2=0Ω, VCC,VEE=±15V VVO=±12.0V, IVO =0mA アンプゲインB Gain B TYP -5% 95 TYP +5% 倍 TR1-TR2=Open, VVO=±4.0V IVO =0mA アンプゲインB Gain B TYP -5% 95 TYP +5% 倍 TR1-TR2=Open, VCC,VEE=±15V VVO=±12.0V, IVO =0mA アンプゲインA リニアリティー - - - ±0.5 % VVO=±4.0V ■ アンプゲインA リニアリティー計算式 VVO= ±4.0V, ±4.0V / 180= ±0.022V A: V1-V2の変動量 B: V2-V3の変動量 計算式:(A-B)/{(A+B)/2}×100 V1 V3 V2 Vo A B 0.022V 015007471-J-00 2015/06
特記無き場合は、Ta=-40°C ~105°C, VCC=13.5V~16.5V, VEE= -VCCの条件になります。 Parameter Symbol min typ max Units Conditions
アンプ部(AC) スルーレート SR 5 8 - V/µs CL =100pF, RL≧2kΩ, Gain=180, 95 出力遅延時間 tdely - 1.0 3.0 µs Gain=180, CL =100pF , RL≧2kΩ 入力換算雑音 VNI - 4 8 µVrms HPF=400Hz, LPF=30kHz VIN+=VIN-= 0V 同相入力信号 除去比 CMR 80 100 - dB Ta=25°C~105°C 75 - - dB Ta=-40°C~25°C未満 保護 VREF 制限電流 - 6 12 20 mA 過熱保護 - 135 155 180 °C ■出力遅延時間 IN+/IN-の立ち上りからVoutの50%変動までの時間を規定しています。 IN+ VOUT Output Delay Time (50%)
IN-10. 機能説明 AP1355AEMは、ホール素子用アンプとして、ホール素子に電流を供給する「駆動電流回路」、ホール 素子の出力電圧を増幅する「増幅回路」、及び、増幅回路出力のオフセットを調整する「オフセット調 整回路」と「駆動電流回路」「オフセット調整回路」を制御する外付けのD/Aコンバータ(AK9820CTH) に電圧(5V)を供給する「基準電圧回路」から構成されています。 10.1 駆動電流回路
IHALLピンからホール素子へ供給される電流(IIHALL)は、ISET端子に外付けされた抵抗(RISET)とVISET
ピンに印加された電圧(VVISET)により、
IIHALL=VVISET / RISET ×3 (Ta=25°C)の関係で設定されます。
また、設定された電流値(IIHALL)には、ホール素子の温特を補正するため 約450ppm/°C (typ.) の温特を
持つように設定されます。ただし、その時の外付け抵抗(RISET)の温特は、0ppm/°Cです。 尚、抵抗(RISET)、電圧(VVISET)の設定範囲は、2.7~7.5kΩ、1.0~5.0V です。 10.2 増幅回路 OPアンプ3個を使った計測アンプ構成となっています。 アンプゲインは、TR1-TR2端子を短絡する事により、95倍/180倍に可変できます。 ∆Vout=∆Vin (100kΩ/10kΩ)(1+2×42.5kΩ/(5kΩ or 10kΩ)) また、出力電圧のDCオフセットは、「オフセット調整回路」にて調整されます。 42.5k 2 .5 k 5 k 2 .5 k 42.5k 100k 100k 10k 10k 増幅回路 V2 V1 VO オフセット調整回路 VB VA TR2 TR1 Figure 2. 増幅回路 オフセット調整回路出力が0Vの時、出力電圧はVO = (100k/10k)×(VB-VA)となり、仮想短絡を前提とす ると、両アンプ(V1,V2)の入力ピンは同電圧と見なせます。VAから42.5k-10k-42.5k-VBまでの経路は、 入力端子に電流が流れないことから、各抵抗に同一電流が流れます。 そのため、 (VA-V1) / 42.5k = (V1-V2) / 10k = (V2-VB) / 42.5k が成り立ちます。 VA-VB = 42.5k / 10k×(V1-V2), V2-VB = 42.5k / 10k×(V1-V2) 上記2式から VA-VB-(V1-V2) = (42.5k+42.5k)/10k×(V1-V2) よって、 VA-V1 = (1+(42.5k+42.5k)/10k)×(V1-V2) VO = 100k/10k×(1+(42.5k+42.5k)/10k)×(V1-V2) となります。 015007471-J-00 2015/06
10.3 オフセット調整回路 VOS端子に印加される電圧により増幅回路出力のDCオフセット電圧を可変します。VOS端子に0~5.0V の電圧を印加する事により、オフセット電圧を+1.85V~-1.85V(typ.)の範囲を可変できます。 ・定数設定式 仕様条件 ① VOSピン:0V VOピン:1.85V ② VOSピン:2.5V VOピン:0V ③ VOSピン:5V VOピン:-1.85V
① から③を横軸VOSピン、縦軸をVOピンに取ると y=1.85-2.5x y=0V時, x=0.74となります。
オフセット調整回路 37k 10k 18.5k 25k V2(VREF) V1(VOS) VA VB VC Figure 3. オフセット調整回路 VB=V2/(37k+10k)×10k 仮想短絡よりVA=VBとなるので、25kに流れる電流は、 I=(V1-VA)/25k=(V1-VB)/18.5k=(V1-(V2×10k)/(10k+37k))/18.5k VC=VA-I×18.5k=VB- I×25k VC=-18.5k/25k×V1+(10k/(10k+37k)×V2×(1+18.5k/25k) VC=-0.74×V1+0.370×V2となります。 VOSはVREF/1023に分割された精度の電圧が印加されます。 10.4 基準電圧回路 5.0Vの基準電圧をVREFピンより出力します。外付けのD/Aコンバータの電源となります。 10.5 保護回路 VREF電流制限 :出力電流を12mA(typ.)以下に制限します。 VO電流制限 :出力電流を±30mA(typ.)以下に制限します。 過熱保護:IC内部の温度が155°C(typ.)を超えるとIC内各回路に供給する電流がオフし、各回路はオフし ます。
11. パッケージ
■ 外形寸法図
・16-pin TSSOP (Unit : mm)
■ マーキング 0. 6 ± 0. 1 0 .1 ± 0. 0 5 0 ~゜ 10゜ ~ 0 .1 3 0. 1 8 6. 4 ± 0. 2 4 .4 ± 0. 1 1 8 16 9 0.13 0.65 ~ 0.19 0.27 5±0.1 0 .9 ± 0. 0 5 S 1 .1 M A X M 0.1 S
XXXXX
(1) 1pin Indication (2) Market No.(3) Date Code (5digits)
西暦年下1 桁、週コード 2 桁、管理コード 2 桁 (1)
AP1355A
(3) (2) 015007471-J-00 2015/0612. 改訂履歴 Date (YY/MM/DD) Revision Page Contents
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