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RL78/G1Eグループ 電荷出力型センサを使用した測定例 アプリケーションノート

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Academic year: 2021

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図  6.7 SPI 通信タイミング
表 6.4  アナログ・リセット受け付け後の SPI 制御レジスタの状態  アドレス SPI 制御レジスタ名称  アナログ・リセット受け付け後の状態 00H CONFIG1  コンフィギュレーション・レジスタ 1  00H  01H CONFIG2  コンフィギュレーション・レジスタ 2  00H  03H MPX1  MPX 設定レジスタ 1  00H  04H MPX2  MPX 設定レジスタ 2  00H  05H MPX3  MPX 設定レジスタ 3  00H  06H GC1  ゲイン制御レジスタ
表 7.1  RL78/G1E(R5F10FMx)のマイクロコントローラ部の機能割付け一覧  周辺機能  機能割付け  CSI21  ポート 7(P73)  RL78/G1E(R5F10FMx)のアナログ部の SPI との通信制御  A/D コンバータ  アナログ入力端子 2(ANI2)に入力されたコンフィギュラブル・アンプ Ch2(非反転アンプ構成)出力(AMP2_OUT)電圧を抵抗分圧回路で降圧した電圧の A/D 変換の制御 ポート 13(P130)  アナログ・リセットの制御  タイマ・アレイ・ユニッ
図 7.2に本アプリケーションノートにおける RL78/G1E(R5F10FMx)のクロック発生回路のブロック図を 示します。 32[MHz](Typ.) 24[MHz](Typ.) 16[MHz](Typ.) 12[MHz](Typ.) 8[MHz](Typ.) 4[MHz](Typ.) 1[MHz](Typ.) 高速オンチップ・オシレータ f IH = 32[MHz](Typ.) 高速システム・クロック 発振回路 水晶/セラミック発振 外部入力クロック f EXfX メイン・システム・クロックのソース選
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