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HyRAL®FPGA設計仕様書

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Academic year: 2021

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図 3.1-1 Base Key Generation 概略ブロック図
図 3.3-1 に暗号化フローを示す。  Plaintext RK1 G1 RK2 F2 RK3 F2IK1IK2 RK4 F1IK3 RK5 F1IK4 RK6 G2 RK7 Ciphertext EORRK1G1RK2F2RK3F2IK1IK2RK4F2IK3RK5F1IK4RK6F1RK7IK5RK8IK6F1RK9G2128Bit Key192,256Bit Key
図 3.4-1 に復号化フローを示す。  Ciphertext RK7 G 2  -RK6 F 1  -RK5 F 1 -IK4IK3 RK4 F 2 -IK2 RK3 F 2 -IK1 RK2 G 1  -RK1 Plaintext EORRK9G2-RK8F1-RK7F1-IK6IK5RK6F1-IK4RK5F2-IK3RK4F2-RK3IK2RK2IK1F2-RK1G1-128Bit Key192,256Bit Key
図 3.4.1-1 内のY0~3 は入力する 128bitデータを意味し、Y0=Y[127:96], Y1=Y[95:64], Y2=Y[63:32],  Y3=Y[31:0]を意味する。同様に、IKi0=IKi[127:96], IKi1= IKi[95:64], IKi2= IKi[63:32], IKi3= IKi[31:0]を意味 する。X0~3 はX0=X[127:96], X1=X[95:64], X2=X[63:32], X3=X[31:0]を意味し、F - 関数の出力である。
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